FPGA和CPLD对比与入门

FPGA和CPLD对比与入门入门介绍:1、EMP240使用很广泛了,8元一片。EMP240顾名思义具有240个宏单元,或者说240个触发器,或者理解成240个bit的存储单元。2、仿真分2步,写逻辑时用QUARTUS自带的仿真;逻辑写完后,最好用modelsim专门仿真。3、如果你需要100个逻辑单元,实际用的可能是120个,因此要留出20%的余量。4、一个小技巧,针对EPM240和570来说,常用的封装T

大家好,又见面了,我是你们的朋友全栈君。

入门介绍:

1、EMP240使用很广泛了,8元一片。EMP240顾名思义具有240个宏单元,或者说240个触发器,或者理解成240个bit的存储单元。

2、仿真分2步,写逻辑时用QUARTUS自带的仿真;逻辑写完后,最好用model sim专门仿真。

3、如果你需要100个逻辑单元,实际用的可能是120个,因此要留出20%的余量。

4、一个小技巧,针对EPM240和570来说,常用的封装TQFP100,这2个芯片封装是向下兼容的,因此,即便决定用240,也要按照570去画板子。焊接是兼容的,同时万一240资 源不够了,还可以换570,非常方便。

CPLD和CPU接口:

1、CPLD大部分是做为CPU的扩展,替CPU完成外部引脚资源的扩展、输入输出时序管理、部分软件功能实现,肯少单独用CPLD。

2、初学者使用CPLD时,可以在IO连线中串联一个51欧姆的电阻,方便测量,更重要的是能保护CPLD的IO,更深一步是能改善高速信号的振铃、信号反射。提高信号完整性。

CPLD和FPGA区别:

1、CPLD比较简单,FPGA更加复杂,在CPLD基础上增加了PLL、硬件乘法器、RAM等资源。Altera的MAX II系列CPLD内部应用了走线池,严格的说已经是FPGA了。

2、前仿真属于逻辑仿真,所有瞬态时序同步发生,用于初期测试逻辑功能是否正确;后仿真则带有延迟特性,这和芯片的内部构造和编译后的内部走线密切相关。后仿真一般就等同于实际板子上跑的结果。如果在PCB板上跑出现问题,则此问题就比较难解决。

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